複数のプロセッサを使用するシステム・テスティングの方法および装置

Abstract

An apparatus for use in testing at least a portion of a system under test via a Test Access Port (TAP) is provided. The apparatus includes a memory for storing a set of instructions of a test instruction set architecture and a processor executing the set of instructions of the test instruction set architecture for testing at least a portion of the system under test via the TAP. The set of instructions of the test instruction set architecture includes a first set of instructions including a plurality of instructions of an Instruction Set Architecture (ISA) supported by the processor and a second set of instructions including a plurality of test instructions associated with the TAP. The instructions of the first set of instructions and the instructions of the second set of instructions are integrated to form the set of instructions of the test instruction set architecture.
テストされるシステムにアクセスするように構成されたテスト・アクセス・ポート(TAP)を介するテストされるシステムの少なくとも一部のテスティングを実行する装置が提供される。この装置は、TAPを介するテストされるシステムの少なくとも一部のテスティングを制御するように適合された命令を実行する第1プロセッサと、TAPへのインターフェースをサポートする第2プロセッサとを含む。第1プロセッサは、テスト命令の実行中に、TAPの制御に関連するTAP関連命令を検出し、TAP関連命令を第2プロセッサに向かって伝搬させるように構成される。第2プロセッサは、第1プロセッサによって検出されたTAP関連命令を受け取り、TAP関連命令を処理するように構成される。第1プロセッサは、第2プロセッサによるTAP関連命令の処理と同時に少なくとも1つのタスクを実行するように構成される。関連する方法も提供される。

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